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二分频电路控制
在许多控制场合、需要对控制信号进行分频，常见的有二分频、四分频控制等。二分频控制即是将诸如输入信号脉冲I0.1分频输出，输出脉冲Q0.0为10.1的二分频。
二分频电路的梯形图、时序图及其语句表如图6-50所示。当输入10.1在A时刻接通(ON)，此时内部标志位存储器 M0.0上将产生单脉冲。输出映像寄存器00.0在此之前并未得电，其对应的动合触点处于断开状态。扫描程序至第2行时，M0.0得电，内部标志位存储器M0.2也不可能得电。扫描至第3行时，Q0.0得电并自锁。此后这部分程序虽多次扫描，但由于M0.0仅接通一个扫描周期，M0.2不可能得电。00.0对应的动合触点闭合，为M0.2得电做好了准备。等到A时刻、输入I0.1接通(ON)，M0.0上产生单脉冲。在扫描第2行时，内部标志位存储器M0.2条件满足得电，M0.2对应的动断触点断开。执行第3行程序时，输出映像寄存器00.0断电，输出信号消失。以后，10.1继续存在，但由于MO，0品单脉冲信号，虽多次扫描第3行，输出映像寄存器CO，0也不可能得电。在A时刻，输入ID1第三次出现(ON)，M0.0上又产生单脉冲，输出Q0.0接通。4时刻，输出Q0.0断电……得到输出正好是输入信号的二分频。这种逻辑每当有控制信号时，就将状态翻转(ON→OFF→ON→OFF→…)，也可用作脉冲发生器。
图6-50二分频电路的梯形图、时序图及其语句表
(a)梯形图;(b)时序图;(c)语句表
用微分上升沿 P指令和两个内部标志位存储器M0.0与M0.2将规则频率的10.1输入信号，转化为脉宽为I0.1两倍的Q0.0信号输出。
图6-4(a)是用DIFU(13)指令组成的二分频电路，在第一个输入脉冲信号0000到来时，1000接通一个扫描周期。因为第三行还未执行，CPU执行第二行时，常开触点0500仍断开，1100为OFF，其常闭触点闭合。执行第二行时，输出继电器被接通并保持。当第二个输入脉冲0000到来，执行第二行时，常开触点0500已接通，1100为ON。执行第三行时，虽有触发脉冲1000，因常闭触点1100已断开，输入继电器变为OFF，其时序如图6-4(b)所示。按上述电路原理，PLC可组成任意分频的二进制分频电路。